图5 接口电路的部分仿真波形

　　由图5可知，在读操作地址为00000025时，开始进行数据的读入，由于每次只能从FLASH中读出8位数据，所以在经过四次读取操作后，读操作结束应答信号有效，将成功将数据04030000读入总线。此电路满足传输协议的要求，可以正确地传输数据。 5 FPGA资源占用情况在完成电路功能仿真后，又对其进行了时序仿真和布局布线，上面的图5即是完成这些要求的RTL级电路顶层图，为了进一步证实本研究的价值，还将本设计通过Quartus II软件将此硬件描述语言的代码转化成.sof文件，并且下载到了FPGA中进行物理层的功能验证，系统的FPGA验证用的是ALTERA公司的Stratix II系列(具体型号为EP2S60F1020C4N)芯片，通过硬件调试，其功能满足串并转换的要求。接口电路的资源占用情况如下表1所示：

　　表1.最小系统资源占用表 Logic utilization 6% Combinational ALUTs 193/48,352(<1%) Dedicated logic registers 275/48,352(<1%) Total registers 275 Total pins 152/719(21%) Total virtual pins 0 Total block memory bits 0/2,544,192(0%) DSP block 9-bit elements 0/288(0%) Total PLLs 0/12(0%) Total DLLs 0/2(0%) 由上表可知，此控制器占用资源很少，这在对成本日益敏感的今天，非常有助于使这个电路的设计具有更小的面积，更快的速度和更低的成本。 6 总结通过对本模块电路软件的详细仿真和硬件电路的功能全面测试，最终实现了正确的数据传送，并且实现了最小系统的功能。而且由于通过了所有软件和硬件的仿真，可以直接应用到SOC设计的产品开发中，有一定的实用价值。

　　参 考 文 献

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